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　　专利摘要显示，描述了用于减少或防止硬件加速器中的存储器体冲突以允许在硬件加速器处对存储器体的并发访问的方法和系统，包括计算机可读介质。硬件加速器的计算小芯片接收用于访问加速器的小芯片存储器的请求。针对请求中的每个请求：在该请求中识别由位序列表示的逻辑地址，并从该序列中获得第一位子集。基于使用第一位子集的存储体生成函数来生成标识符。该标识符识别小芯片存储器的物理存储器体当中的特定存储体。每个请求都使用针对该请求生成的相应的存储体标识符被处理。响应于处理该请求，在同一时钟周期期间并发地访问多个相异的存储器体。